Ingénieur Vérification ASIC
Il y a 5 mois
Eviden est une ligne d’activités du Groupe Atos qui réalise un chiffre d'affaires annuel d'environ 5 milliards d'euros. Acteur clé du numérique de prochaine génération et leader mondial du cloud, du calcul avancé et de la sécurité, Eviden fait bénéficier de son expertise l’ensemble des secteurs d’activités, dans plus de 47 pays. En réunissant des technologies de pointe sur l'ensemble du continuum numérique, combinées à l’expertise de ses 55 000 talents, Eviden ouvre le champ des possibles de la donnée et de la technologie, aujourd'hui et pour les générations à venir.
Descriptif mission :
Dans le cadre de développement d’ASIC de types contrôleur réseau, routeur, contrôleur de cohérence de cache et processeur à destination des serveurs haut de gamme et haute performance Bull (serveurs « big data » et « exascale »), la mission consiste à participer à la vérification d’un ASIC complexe en utilisant les méthodologies de vérification fonctionnelle « Constraint-Random, Coverage Driven » sous-jacentes au standard de vérification UVM.
Principales taches:
• Acquérir la connaissance de l'architecture et la microarchitecture de l’ASIC en étudiant les spécifications et en interagissant avec les équipes d’architecture et de design logique.
• Rédaction des spécifications de vérification. • Rédaction des plans de test en étroite collaboration avec l’équipe design logique. • Développement des environnements de vérification (UVM-SystemVerilog/C++), les tests et les modèles de couverture • Suivre, analyser et debugger les erreurs de simulation. • Suivre et analyser les résultats couverture des simulations pour améliorer les tests en conséquence et ainsi atteindre les objectifs de couverture dans les délais impartis. Compétences:
• Expérience concrète et réussie à la vérification de SoC/ASIC et IP complexes.
• Experience avec la méthodologie de vérification UVM.
• Expérience en développement d’environnements de vérification Constraint-Random/Coverage-Driven en SystemVerilog/C++ (drivers/ monitors, tests aléatoires contraints, checkers auto-vérifiants et modèle de couverture en SystemVerilog-Covergrourp/SVA) et maitrise de la programmation orientée objet
• Connaissance des outils de simulation et de suivi de couverture
• Efficacité dans la résolution de problèmes par l’identification rapide de leur cause fondamentale et par l’élaboration de correctifs ou contournements
Faire partie des pionniers d'Eviden, ça vous dit?
C'est justement cette audace et cette curiosité qu'on recherche chez nos talents pour grandir ensemble, transformer des possibilités en réalité pour nos clients et façonner le futur de la Tech et de la société.
Chez Eviden, diversité, équité et inclusion sont au cœur de notre politique RH. Nos métiers sont tous ouverts aux personnes en situation de handicap et ce, quelle que soit la nature de celui-ci. Grâce à nos programmes qui soutiennent toutes les diversités, nos collaborateurs et collaboratrices sont pleinement impliqués pour faire vivre cette culture de l’inclusion.
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il y a 3 semaines
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il y a 4 semaines
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Ingénieur Vérification ASIC
Il y a 5 mois
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Senior ASIC Design Manager
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Ingénieur.e Digital SoC/ASIC Design F/H/N
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Asic Architect R&d
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R&D Design Manager
Il y a 2 mois
Valbonne, France IC Resources Temps pleinWorking for a major player in the semiconductor industry...This is a unique and complex technical management position. It would suit a senior level design engineer / architect or team lead / manager, who wants to progress their career in a brand new, and technically highly-challenging ASIC IP development environment. Within the role, you would be responsible...
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Ingénieur Verification SoC
Il y a 2 mois
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