Stage: Ingénieur Vérification Asic R&D

il y a 4 jours


Les ClayessousBois, France EVIDEN Temps plein

Eviden regroupe les activités Digital, Cloud, Big Data et Sécurité d'Atos et sera un leader international d'une transformation numérique fiable, durable et basée sur les données. Acteur clé du numérique de prochaine génération et leader mondial du cloud, du calcul avancé et de la sécurité, Eviden fera bénéficier de son expertise l'ensemble des secteurs d'activités, dans plus de 53 pays. L'orchestration de technologies de pointe sur l'ensemble du continuum numérique, combinée à l'expertise de ses 57 000 talents, permettra à Eviden d'étendre le potentiel des solutions à la disposition des entreprises et des autorités publiques, contribuant ainsi à façonner leur avenir numérique. Au sein du groupe Atos, le chiffre d'affaires annuel des activités d'Eviden est d'environ 5 milliards d'euros. Le département ASIC d'EVIDEN-BULL oeuvre à la réalisation de circuits destinés aux serveurs et aux supercalculateurs conçus et vendus par EVIDEN. Ce marché est en pleine expansion et en tant que leader européen dans ce domaine, nous nous devons d'être irréprochable dans la qualité de nos produits. Ainsi, les équipes Vérification veillent à la validation et au respect des spécifications en utilisant les outils et les méthodologies les plus avancés. Cela entraîne par conséquent une perpétuelle amélioration et adaptation de nos modèles de simulation, qui nous amène aujourd'hui à proposer un stage sur la réalisation d'un module de contournement PCIe, adapte au formalisme/API d'une VIP PCIe commerciale.  Ainsi, au sein de notre équipe Vérification des Clayes-sous-bois, vous utiliserez le langage System Verilog et la méthodologie UVM afin de mettre en place un system de contournement PCIe complexes dont nos futurs environnements bénéficieront. Vous travaillerez en étroite collaboration avec les équipes de conception qui vous permettront d'acquérir d'une part, une bonne maîtrise de la programmation objet basé sur la bibliothèque UVM et d'autres part, d'obtenir une vision globale d'un système hardware et en particulier une bonne connaissance des erreurs classiques en design logique. Vos missions : * Etude bibliographique et prise de connaissance des protocole et IP ; * Etude de la méthodologie SystemVerilog UVM ; * Mise en place de l'environment extraction/visualisation de transaction protocol BXI Portals sur un ASIC réel utilisé comme exemple Votre profil  * Vous êtes en cours d'obtention de votre Bac + 5, Diplôme d'ingénieur ou cycle universitaire équivalent, avec une spécialisation en micro-électronique/conception de circuits intégrés/logiciel embarqué ; * Vous parlez couramment anglais, ce qui vous permettra d'intervenir dans un environnement international ; * Vous êtes motivé et autonome et aimez travailler en équipe ; * Vous faîtes preuve de curiosité, d'autonomie et d'une capacité à finaliser un projet ;   Durée du stage de fin d'étude : 6 mois à compter de Mars 2026   Pourquoi nous rejoindre : * Une ambiance de travail et des locaux pour vous épanouir : salle de sport, un restaurant d'entreprise ; * Des évènements en interne dans l'équipe ;  * Télétravail à 60%.   Sous réserve d'une motivation certaine par le candidat.e, une possibilité d'embauche en CDI pourra être proposée. Rejoignez-nous Stage basé aux Clayes-sous-bois.



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    Atos est un leader international de la transformation digitale avec environ collaborateurs et un chiffre d'affaires annuel d'environ 10 milliards d'euros. Numéro un européen du cloud, de la cybersécurité et des supercalculateurs, le Groupe fournit des solutions intégrées pour tous les secteurs, dans 68 pays. Pionnier des services et produits de...


  • Les Clayes-sous-Bois, France Forums Talents Handicap Temps plein

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    Ingénieur Implémentation Physique ASIC (3nm) H/F - Eviden Eviden est acteur clé du numérique de prochaine génération et leader mondial du cloud, du calcul avancé et de la sécurité. Nous opérons dans tous les secteurs d’activité, et faisons rayonner notre expertise sur l’ensemble du continuum numérique. Le poste consiste à implémenter des...


  • Les Clayes-sous-Bois, France Atos Temps plein

    **Job Applicant Privacy Notice**: **Senior ASIC/FPGA Prototyping Engineer R&D (H/F)**: - Publication Date: Aug 12, 2025 - Ref. No: 535282 - Location: Les Clayes-sous-Bois, FR **About Eviden** Eviden is a next-gen technology leader in data-driven, trusted and sustainable digital transformation with a strong portfolio of patented technologies. With...


  • Les Clayes-sous-Bois, France Atos Temps plein

    OverviewBienvenue chez Eviden, acteur clé du numérique de prochaine génération et leader mondial du cloud, du calcul avancé et de la sécurité ! Eviden opère dans tous les secteurs d’activité, et fait rayonner son expertise sur l’ensemble du continuum numérique. Nous rejoindre, c’est à la fois une opportunité exaltante de contribuer au futur...

  • ASIC Architect R&D

    il y a 5 jours


    Les Clayes-sous-Bois, Île-de-France Atos Temps plein

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    il y a 1 jour


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  • Les Clayes-sous-Bois, France microTECH Global Ltd Temps plein

    Job Title: Digital Verification Engineer Job Type: Permanent Location: Sophia Antipolis OR Les Clayes-sous-Bois FRANCE Start: ASAP My client is a next-generation digital business, it holds worldwide prominence in digital, cloud, data, advanced computing, and security. With a presence in more than 47 countries and a team of 55, world-class talents, the...

  • STA Expert Engineer

    il y a 19 heures


    Les Clayes-sous-Bois, France Atos SE Temps plein

    A leading technology company is seeking a STA expert engineer for its R&D team in the Paris area. The successful candidate will focus on timing constraints definition and analysis for integrated circuits. With a minimum of 5 years of experience in timing analysis tools, you'll work closely with design and flow teams to ensure timing closure for ASIC flows....