Ingénieur R&D C++ H/F

il y a 4 semaines


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Mission

L'objectif de ce poste est de participer à la vérification d'un ASIC complexe en utilisant les méthodologies de vérification fonctionnelle « Constraint-Random, Coverage Driven » sous-jacentes au standard de vérification UVM.

Compétences requises
  • Acquérir la connaissance de l'architecture et la microarchitecture de l'ASIC en étudiant les spécifications et en interagissant avec les équipes d'architecture et de design logique.
  • Rédaction des plans de test en étroite collaboration avec l'équipe design logique.
  • Développement des environnements de vérification (UVM-SystemVerilog/C++), les tests et les modèles de couverture.
  • Expérience en développement d'environnements de vérification Constraint-Random/Coverage-Driven en SystemVerilog/C++ (drivers/monitors, tests aléatoires contraints, checkers auto-vérifiants et modèle de couverture en SystemVerilog-Covergroup/SVA) et maîtrise de la programmation orientée objet.
  • Connaissance des outils de simulation et de suivi de couverture.
Contexte

Ce poste est rattaché à la ligne d'activités Eviden du Groupe Atos, qui réalise un chiffre d'affaires annuel d'environ 5 milliards d'euros. Eviden est un acteur clé du numérique de prochaine génération et leader mondial du cloud, du calcul avancé et de la sécurité.



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    il y a 4 semaines


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