Stage - Implémentation D'un Algorithme Sur Un Fpga
il y a 21 heures
L’algorithme DAS (Delay And Sum) est l’algorithme de référence pour focaliser les ondes ultrasonores dans les échographies et l’inspection des métaux. Il permet de scanner une personne ou un objet avec des ultrasons et de voir en profondeur. (Nous allons voir l’invisible)
Lors de votre stage, vos principales missions seront les suivantes:
Entraînement VHDL sur FPGA (revue des meilleures techniques/pratiques)
Etude de l’algorithme du DAS et conception de l'architecture
Implémentation de l’algorithme en VHDL sur cible FPGA
Tests avec des données réelles (pas d’expérimentation cependant)
Vous êtes en 3ème année de cycle ingénieur, et vous avez déjà des connaissances acquises en cours et/ou en TP sur les langages VHDL / Verilog / SystemVerilog, Vous avez, de préférence, des bases en simulations / testbench au niveau IP et/ou Top Level.
Dynamique, passionné(e) et motivé(e), vous êtes en quête de défis techniques.
Le stage se déroulera dans nos locaux de Aix-en-Provence et aura une durée mínimale de 6 mois.
**Le meilleur pour la fin : les + ELSYS**:
**Conditions de travail très agréables**: locaux spacieux, laboratoire d’électronique,...
Support technique assuré pour progresser
Café et fruits gratuits
Connaissance en Contrée et Tarot appréciée
Un CSE très actif (ski, karting, œnologie, Bubble foot etc.)
Une ambiance bienveillante et positive
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