[stage] Conception de Vip

il y a 1 semaine

Nantes, France Elsys Design Temps plein

Description du sujet

ELSYS Design participe actuellement à plusieurs projets de Vérification de System On Chip (SoC) pour ses clients
dans divers secteurs (Automobile, IoT, Aéronautique). Notre équipe Métier dédiée prend en charge la
Dans le cadre de ces collaborations clients, vous interviendrez sur le développement d’agents UVM
(Drivers/Monitors) à intégrer dans l’environnement de test de certains périphériques (IP) de ces SoC. Vous
serez encadré par un tuteur technique et notre équipe composée d’ingénieurs expérimentés dans chacun des
domaines de compétence.

**Le stage se déroulera en plusieurs étapes**:

- Prise en main de l’environnement global de développement
- Montée en compétences sur l’état de l’art des méthodologies SV/UVM, training complet et

approfondi.
- Conception et implémentation d’agents UVM (VIPs)
- Création d’un banc de test de la VIP : code/functional coverage
- Intégration de la VIP dans l’environnement de la plateforme client
- Rédaction du rapport de test / Manuel utilisateur

Ce sujet s’adresse donc à des personnes désirant améliorer leurs compétences dans le domaine de

**l’électronique embarqué sur les aspects**:

- Vérification de SoC
- Environnement de simulation
- Mise en œuvre de blocs fonctionnels en SV
- Développement de scénarios de simulation en UVM
- Analyse des chronogrammes de simulation
- Mise en œuvre de code C dans l’élaboration des Test Cases de simulation

Technologies utilisées
- Environnement de simulation (Cadence Excelium, IMC)
- SoC, Verilog, VHDL, System Verilog, C
- Interfaces telles que AHB, APB, I²C, SPI, DDR, DMA,
Vous êtes en 3e année de cycle ingénieur ou dernière année de Master.
en équipe sont des qualités essentielles.

**Compétences requises**: Langage VHDL/verilog/SystemVerilog, connaissance des ASIC/FPGA, langage C, esprit
de synthèse, autonomie et rigueur. Vous rédigez aisément en anglais (documentation technique et manuel
utilisateur).
Ce stage conventionné est rémunéré.
La mission peut être réalisée dans le cadre d’une année de césure ou d’un stage de fin d’études.

**Lieu**: Rennes

Compétences acquises
- Verification System On Chip (HW/FW)
- Méthodologies SV/UVM
- Travail en mode projet
- Cycle de développement en V
- Rédaction documentaire

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