[stage] Implémentation D’une Ip Ethernet en Rtl
il y a 1 jour
**Mission et objectifs**:
Le design demeure une partie indispensable dans la conception d’un ASIC ou un FPGA.
Que ce soit du pur design RTL, de l’intégration d’IPs basiques ou complexes ou bien du sanity check sur le code déjà élaboré, vous trouverez la partie qui vous intéresse le plus et dans laquelle vous souhaitez évoluer tout au long de votre carrière. Au sein du département micro-électronique avec des ingénieurs expérimentés en design et en vérification, vous approfondirez vos connaissances et vos compétences tout au long du stage. L’objectif sera de maitriser les différentes étapes du flot de conception pour la partie Design.
Lors de votre stage, vos principales missions seront donc les suivantes :
Etudier et comprendre les spécifications de l‘IP Ethernet à Implémenter.
Etudier et comprendre l’architecture du SoC envisagé (NGUltra de NanoXplore)
Proposer une architecture qui répond complètement au cahier des charges.
Implémenter/Intégrer l’IP en RTL (VHDL ou Verilog) en respectant les « Coding Rules » internes au groupe.
Proposer un testbench pour une simulation fonctionnelle de l’IP.
Proposer un FPGA de test qui permet de valider l’IP sur cible (architecture à base processeur RISC-V ou ARM)
Implémenter le FPGA de test
Créer un logiciel de test embarqué baremetal pour transmettre/recevoir trames Ethernet avec l’IP.
Faire la mise au point su carte.
**Profil recherché **:
Vous êtes en 3ème année de cycle ingénieur en option Micro-Electronique, et vous avez déjà des connaissances acquises en cours et/ou en TP sur les langages VHDL / Verilog / SystemVerilog et C. Vous avez aussi des bases solides en simulations / testbench au niveau IP et/ou Top Level.
Dynamique, passionné(e) et motivé(e), vous êtes en quête de défis techniques.
Le stage se déroulera dans nos locaux de Toulouse et aura une durée mínimale de 6 mois.
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Stage - IP Vhdl Spatial H/F
il y a 1 semaine
Toulouse, France Lgm Temps pleinQuel sera mon domaine d'intervention ? FPGA est l'abréviation de « Field-programmable gate array », ce qui peut être traduit en français par « réseau de portes programmables sur site ». C'est un circuit intégré fait pour être (re)programmé par l'utilisateur après sa fabrication en utilisant un langage informatique spécifique, donc sans modifier...
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Stage - IP VHDL Spatial (H/F)
il y a 1 semaine
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Ingénieur R&D ASIC
il y a 2 semaines
Toulouse, France Capgemini Engineering Temps pleinDescription du poste :Capgemini Engineering, leader mondial des services d'ingénierie, rassemble des équipes d'ingénieurs, de scientifiques et d'architectes pour aider les entreprises les plus innovantes dans le monde à libérer leur potentiel. Des voitures autonomes aux robots qui sauvent des vies, nos experts en technologies digitales et logicielles...
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il y a 4 jours
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Ingénieur en Développement FPGA-IP
il y a 18 heures
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Ingénieur en Développement FPGA-IP
il y a 2 semaines
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il y a 1 semaine
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