Stage - Vérification D’ip Uvm Vs. Python Cocotb

il y a 2 jours

Grenoble, France Elsys Design Temps plein

Description du sujet
**Contexte**:
ELSYS Design apporte des solutions techniques à mettre en œuvre pour ses clients dans tous les domaines d’activités dont celui de la microélectronique.
Un des objectif d’Elsys Design est d’évaluer les performances de deux méthodes de vérification numérique de circuits intégrés pouvant potentiellement être utilisées chez ses clients. L’une est basée sur l’« Universal Verification Methodology » (UVM) et l’autre met en œuvre un testbench réalisé avec le framework CocoTB. Ce stage s’inscrit donc dans une démarche d’étude, de conception, puis d’évaluation d’environnements de vérification numérique.
**Le stage**:
L’objectif du stage est de de mettre en place un environnement de vérification numérique d’IP de protocoles standards tels que l’UART ou l’I2C en utilisant deux méthodologies. La première, classique et très utilisée dans l’industrie, mettra en œuvre un testbench SystemVerilog/UVM. La seconde, plus novatrice, utilisera le framework CocoTB, qui permet de créer un testbench en utilisant le langage Python.
Ce stage s’intéresse également à l’évaluation des deux méthodes de vérification numérique. Il s’agira de définir des indicateurs de performance lors la mise en place puis de la mise en œuvre des environnements de vérification.
Tâches prévues
**Les tâches suivantes devront être réalisées**:
Spécifications de l’environnement de test
Etude des deux méthodologies ;
Choix techniques concernant les outils utilisés ;
Définition des IP à tester.
Mise en place des environnements de vérification
Rédaction d’un document de conception pour chaque environnement ;
Conception de l’environnement SystemVerilog/UVM ;
Conception de l’environnement CocoTB.
Développement des tests
Développement de tests UVM pour chaque IP ;
Développement de tests Python pour chaque IP.
Evaluation des performances
Définition des indicateurs de performance ;
Mesure des indicateurs de performance tout au long du projet ;
Ecriture d’un rapport de test sur l’évaluation des performances.
**Technologies utilisées**:Les technologies utilisées sont les suivantes**:
Langage HDL SystemVerilog et/ou VHDL
UVM
Python et ses bibliothèques (numpy, matplotlib)
Framework CocoTB
**Simulateur de vérification numérique**: Xcelium ou Modelsim
Compétences acquises
**Les principales compétences acquises seront**:
Maitrise de la mise en place d’un environnement de vérification
Développement de tests
Maitrise d’un simulateur professionnel
Spécification, Conception, Validation
Pratiques du métier d’Ingénieur
Vous êtes en 3ème année de cycle ingénieur en option Electronique ou Micro-Electronique, et vous avez déjà des connaissances acquises en cours ou en TP sur la conception et le développement de FPGA ou ASIC.
Votre implication sur des projets extrascolaires de développements hardware (Coupe de France de Robotique, fab labs, etc.) est un plus qui sera apprécié. Une première expérience en développement hardware avec une cible FPGA sera un atout majeur.
Autonomie, enthousiasme pour les nouvelles technologies, rigueur et travail en équipe sont des qualités essentielles. Dynamique, passionné(e) et motivé(e), vous êtes en quête de défis techniques.

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