Principal Physical Design Engineer

Il y a 2 jours

Biot, Provence-Alpes-Côte d'Azur, France Arteris Temps plein

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Ingénieur Sénior CAD pour flot d'implémentation SoCs H/F

Lieu

France, Montigny-le-Bretonneux

Arteris connecte l'innovation.

Notre technologie aide les entreprises les plus visionnaires au monde - des startups aux leaders du Fortune 500 - à concevoir des semi-conducteurs plus intelligents et plus rapides, notamment des SoC et des chiplets. De la voiture que vous conduisez à l’IA dans le cloud, Arteris connecte les technologies innovantes qui façonnent le monde de demain.

Votre rôle en tant qu'Ingénieur(e) Sénior CAD pour flot d'implémentation SoCs

Rejoignez notre équipe d’ingénierie innovante et contribuez au développement d’IP semi-conducteurs hautement configurables utilisées dans les System-on-Chip (SoC) les plus avancés. Dans ce rôle, vous serez responsable de la génération, de l’implémentation et de la vérification des flows et collatéraux d’implémentation physique pour des produits de pointe.

Vous collaborerez étroitement avec les équipes hardware et software afin d’améliorer les méthodologies d’implémentation physique, résoudre des problématiques complexes d’intégration et garantir des livrables de haute qualité sur différents environnements EDA.

Les Bénéfices Du Poste

Tu travailleras sur FlexNoC, le produit leader du marché des IP système.
Tu auras un rôle critique en supportant un grand nombre de clients tels qu'AMD, Samsung, Altera, Microchip, Toshiba, etc.
Tu toucheras à plein d'outils EDA : Design Compiler, Genus, etc.
Tu bénéficieras d'une grande autonomie et tu seras formé pour monter en compétences sur les technologies que tu maîtrises le moins.
Tu seras aidé à tout moment dès que tu auras des questions. L'équipe est actuellement composée de 7 personnes.
Tu travailleras dans un groupe international ambitieux où tu pourras évoluer vers des postes de Designer, Product Engineer, Architecte, CAE, FAE, etc.

Responsabilités clés

Développer, maintenir et déboguer des flows et contraintes d’implémentation physique à l’aide d’outils EDA tiers tels que Cadence et Synopsys.
Définir, documenter, développer et exécuter des tests de vérification pour les flows d’implémentation physique et la couverture au niveau système.
Analyser les métriques de qualité d’implémentation et valider les résultats sur plusieurs configurations.
Déboguer les problèmes d’implémentation, régressions et anomalies liées aux flows/outils.
Contribuer à l’amélioration continue des méthodologies, stratégies d’implémentation et flows d’automatisation en phase avec les pratiques modernes de conception de semi-conducteurs.
Collaborer avec les équipes hardware et software pour résoudre les problèmes de compatibilité matériel/logiciel et d’interfaces.
Interagir avec les utilisateurs internes et parties prenantes afin de définir les exigences système, faire évoluer les flows et fournir un support technique.
Participer à la documentation des processus et aux bonnes pratiques d’ingénierie.

Ce que vous apportez idéalement

5+ années d’expérience en conception de circuits digitaux et implémentation physique.
Solide connaissance des flows d’implémentation physique et des outils EDA tels que Cadence et Synopsys (la maîtrise de Design Compiler/Fusion Compiler ou Genus est nécessaire).
Expertise en débogage d’implémentation physique et analyse des résultats.
Bonne maîtrise des contraintes de timing, des concepts STA et des méthodologies d’analyse temporelle (obligatoire).
Expérience des langages de description matérielle et de scripting, notamment Python, RTL et TCL.
Excellentes capacités d’analyse, de résolution de problèmes et de débogage.
Très bonnes compétences en communication et collaboration.
Capacité à travailler de manière autonome dans un environnement d’ingénierie dynamique.

Bonus si vous avez

Expérience avec des IP hautement configurables ou des flows d’intégration SoC.
Connaissance des méthodologies de vérification et de validation orientées couverture.
Expérience dans l’amélioration de flows CI/CD ou d’automatisation pour des environnements d’implémentation semi-conducteur.
Exposition aux technologies de gravure avancées et aux techniques d’optimisation basse consommation.

Formation

Diplôme Bac+5 ou Doctorat en Génie Électrique, Informatique, Génie Informatique ou domaine équivalent.

Rémunération estimée

Entre 50 000 € et 70 000 € brut annuel. La rémunération sera déterminée selon votre expérience, votre localisation et les pratiques applicables aux postes similaires.

À propos d'Arteris

Arteris est un leader mondial des System IP utilisés dans les semi-conducteurs afin d’accélérer la création de silicium

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Les Bénéfices Du Poste

Responsabilités clés

Ce que vous apportez idéalement

Bonus si vous avez

Formation

Rémunération estimée

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