Ingénieur Design ASIC RTL pour SoC
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CELAD recrutepour un poste d’Ingénieur design ASIC (RTL) / Digital IC designer confirmé près de Rousset (13). Missions: concevoir et maintenir des modules RTL pour processeurs sécurisés, optimiser microarchitecture et réaliser validations et débogage.
Le candidat doit avoir ≥5 ans d’expérience en conception numérique ASIC, maîtrise SystemVerilog/Verilog/VHDL, et connaissance en Python/C++. Anglais requis pour échanges internationaux.
#J-18808-Ljbffr-
Ingénieur design ASIC
Il y a 1 mois
Rousset-Serre-Ponçon, Provence-Alpes-Côte d'Azur, France CELAD Temps pleinIngénieur design ASIC (RTL) / Digital IC designer confirmé (H/F) Localisation de la mission : Rousset (13) Présentiel: Rousset (13) – Expérience de 5 ans minimum Nous poursuivons notre développement dans le Sud-Est et recrutons un Digital IC Design Engineer (ASIC) pour l’un de nos clients situé vers Rousset. Responsabilités Concevoir, développer...