Alternance-environnement de Vérification Uvm Pour

il y a 2 semaines


Vallauris, France Elsys Design Temps plein

Pour faire face au défi que constitue la vérification d’ASIC/SoC toujours plus complexes, l’industrie du semi-conducteur converge vers l’adoption universelle d’une méthodologie de vérification baptisée UVM.
Cette méthodologie favorise la modularité, la réutilisabilité et l’extensibilité. Elle se base sur des techniques résumées sous les termes de « programmation orientée objet », « Self-Checking Verification Environment », « Constraint Random Tests» et « Coverage/Metric Driven Verification ».
Lors de votre alternance, vos principales missions seront donc les suivantes :
Etudier et comprendre le langage SystemVerilog et la méthodologie UVM
Mise en place de l'environnement de simulation UVM permettant de se connecter au Design Under Test via des interfaces.
Mise en place du modèle de vérification du DUT.
Mise en place de tests aléatoires contraints et du modèle de couvertures du DUT. (functional coverage / code coverage)
La vérification a l'avantage d'associer les domaines du développement software et hardware.
En plus d'acquérir une bonne maîtrise de la programmation objet basée sur la bibliothèque UVM, cette alternance vous permettra de développer une vision globale de la réalisation d'un système hardware et en particulier une bonne connaissance des erreurs classiques en design.
Vous rentrez en dernière année de cycle ingénieur en option Micro-Electronique, et vous avez déjà des connaissances acquises en cours ou en TP sur les langages VHDL / Verilog / SystemVerilog, C/C++.
Vous avez aussi des bases solides en simulations / testbench au niveau IP et/ou Top Level.
Dynamique, passionné(e) et motivé(e), vous êtes en quête de défis techniques.
L'alternance se déroulera dans nos locaux de Sophia Antipolis et aura une durée mínimale de 12 mois.



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  • Vallauris, France ELSYS Design Temps plein

    Dans le cadre de 2 nouveaux projets automobiles pour des futures systèmes autonomes et connectés, la mission consiste à prendre en charge la vérification bloc/top level de SoC complexes : Les principaux objectifs des postes sont : - Analyse de l'architecture - Rédiger la plan de vérification bloc (PCIx, DMA, HSM, PMU) - Rédiger les plans de test -...


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  • Vallauris, France Elsys Design Temps plein

    Le design demeure une partie indispensable dans la conception d’un ASIC ou un FPGA. Que ce soit du pur design RTL, de l’intégration d’IPs basiques ou complexes ou bien du sanity check sur le code déjà élaboré, vous trouverez la partie qui vous intéresse le plus et dans laquelle vous souhaitez évoluer tout au long de votre carrière. Au sein du...


  • Vallauris, Provence-Alpes-Côte d'Azur, France ELSYS DESIGN Temps plein

    Nous sommes à la recherche de talentueux ingénieurs pour rejoindre nos équipes et contribuer à des projets stimulants dans les domaines de l'automobile, des supercalculateurs, de l'IoT et de la Défense.En tant qu'ingénieur, vous serez un acteur clé dans le processus de conception de circuits intégrés, avec pour objectif principal l'intégration...

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    Vallauris, France JobiJoba FR S2 Temps plein

    Votre mission Nous recherchons un(e) Ingénieur conception FPGA (F/H). Au sein d’une équipe de spécialistes, nous intervenons sur un projet pour la communication sans fil. Vous prendrez en charge la conception FPGA : – Analyse de spécifications et standards – Participation à la définition et revue de l’architecture – Codage Verilog –...

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    Vallauris, France 5IS Temps plein

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    Dans le cadre de son fort développement, Lyleoo recherche un(e) Assistant(e) administratif(ve) et commercial(e) pour renforcer son service Support / Administration / Commercial.Rattaché(e) au Responsable du Service Administratif, vous jouerez un rôle clé dans le bon fonctionnement administratif et commercial de l'entreprise.Vos missions...