Ingénieur Vérification UVM ASIC – LPDDR6
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ELSYS Design recherche un ingénieur vérification UVM ASIC F/H à Aix-en-Provence, intégré à une équipe internationale dédiée au test, essai et validation de blocs complexes.
Vous concevrez des séquences UVM, piloterez des tests multi‑config et analyserez les logs, en veillant à la couverture fonctionnelle et au respect des spécifications LPDDR6, SystemVerilog et Perforce; l’anglais est obligatoire.