Stage : Conception D’une Plateforme Logicielle
il y a 1 semaine
**Contexte**:
ELSYS Design est amené à mettre en œuvre pour ses clients des IPs (intellectual Property) qui permettent de réaliser des interfaces, des traitements ou des bridges au sein des composants FPGA.
L’objectif pour ELSYS Design cette année est de concevoir un framework SoC (System On Chip) modulable à base de RISC-V sur cible FPGA permettant d’accueillir et de valider le bon fonctionnement et le respect des spécifications de plusieurs IP propriétaires ou non.
La réalisation de ce framework SoC permet de capitaliser sur notre expertise métier et de faire profiter aux stagiaires d’une vue d’ensemble sur la conception d’un système programmable.
**Le framework SoC est composé**:
- D’une plateforme FPGA, elle-même composée
- d’un sous-système RISC-V (RISC-V, ROM, RAM, Flash, DMA, UART, Ethernet, JTAG)
- d’un sous-système HW à base d’IP d’interface (SPI, UART, etc.) et d’IP de co-processing (Pooling, CMAC-AES, etc.)
- D’une plateforme logicielle, elle-même composée
- de logiciel embarqué exécuté sur le sous-système RISC-V
- de logiciel applicatif exécuté sur le PC hôte.
**Le stage**:
L’objectif de ce stage sera de développer la plateforme Logicielle.
Le logiciel embarqué permet de s’interfacer avec les IPs de la plateforme FPGA:
- Développement d’une couche Hardware Abstraction Layer (HAL) pour créer les canaux de communication avec les IP par DMA, Mémoires de partage, et FIFO
- Développement d’une couche BSP (API des IPs à interfacer)
- Développement d’une couche de communication avec le PC hôte
- Tests d’intégration pour test des APIs
- Tests de validation pour test d’un cas nominal de fonctionnement.
- Automatisation des tests
La cible du logiciel embarqué est le cœur RISCV NEORV32. Il n’est pas prévu d’avoir un Operating System (OS). Le langage de programmation du logiciel embarqué est le C.
Des tests d’intégration et validation sur cible permettront de démontrer le bon fonctionnement du framework SoC complet.
Le stagiaire de la plateforme Logicielle sera encadré par un de nos leaders techniques Logiciel et bénéficiera du soutien de l’ensemble de nos équipes ingénieurs.
Le projet « framework SoC » sera piloté par un chef de projet qui permettra d’assurer la synchronisation des travaux de la plateforme FPGA, de la plateforme logicielle et l’intégration/validation du framework SoC complet.
**Les technologies utilisées**:
- RISCV
- UART, Ethernet, DMA
- FPGA Xilinx
- C, Python, C#, Qt
Vous êtes en 3ème année de cycle ingénieur en option système embarqué, et vous avez déjà des connaissances acquises en cours ou en TP.
Autonomie, enthousiasme pour les nouvelles technologies, rigueur et travail en équipe sont des qualités essentielles.
Votre implication sur des projets extrascolaires de conception (Coupe de France de Robotique, fab labs, projet personnel, junior entreprise, etc.) est un plus qui sera apprécié.
Ce stage est conventionné et rémunéré.
La mission peut être réalisée dans le cadre d’une année de césure ou d’un stage de fin d’études.
**Lieu**: Rennes
**Les principales compétences acquises seront**:
- Maitrise du développement d’un système complet (HW/SW)
- Travail en mode projet
- Développement logiciel embarqué bare-metal sur cible RISC-V
- Automatisation des tests
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